在win10下建设网站,wordpress禁止谷歌字体,辽宁建筑工程网,成都网站建设金网科技1、 【问题】Pin Planner 的使用问题#xff1a;在QuartusII 7.2 #xff0c;时序仿真都通过#xff0c;但是#xff0c;一旦使用Pin Planner设定引脚后#xff0c;时序仿真就发生变化#xff0c;与功能仿真结果不一致#xff0c;不是理想的结果。使用Pin Planner时要注…1、 【问题】Pin Planner 的使用问题在QuartusII 7.2 时序仿真都通过但是一旦使用Pin Planner设定引脚后时序仿真就发生变化与功能仿真结果不一致不是理想的结果。使用Pin Planner时要注意些什么问题呢 【解答】如果在没有设定引脚时就进行时序仿真那么在后仿真就会不准确。因为当设定引脚以后需要重新进行布局布线这和没有设定引脚是不同的因此布线的改变自然会影响到时序的改变。通常的做法是先做好所有的设定生成网表文件和延时文件再加上激励文件进行仿真这个时候的仿真结果是最接近实际情况的。通常的pin设定没有特定要求差分信号是成对的。所以请不要搞错。时钟信号尽量使用专用的时钟引脚普通I/O没有什么限制做好时序约束就可以了。 2、【问题】怎样配置cyclone FPGA的管脚功能 【解答】FPGA芯片的引脚分为好多类有通用IO有时钟网络有复位网络这些引脚的具体功能是在布线时由用户选择的。你可以自由的配置这些引脚的功能但最好根据芯片的数据手册进行选择如将时钟配置到专用时钟引脚上将复位配置到专用复位引脚上否则会影响最终的布线结果。 3、 【问题】分配fpga管脚时该怎么选择引脚有什么属性需要考虑quartus2中引脚有几个属性ReservedGroupI/O Bank,Vref Group,I/O standard( 3.3-V LVTTL(default) )分别是什么意思要怎么设置 【解答】首先说IO standard这个是用于支持对应不同的电平标准。FPGA IO口的电压由IO bank上的VCC引入。一个bank上引入3.3V TTL电平那么此时整个bank上输出3.3V的TTL电平。设置这个第一是为了和current strength一起计算功率。第二个是用于在IO口上加载正确的上拉/下拉电阻。只要你设置完成Quartus会按照你的电平标准自动布线。第二是IO Bank你在quartus pin planner 的top view下右键然后点击 show IO banks这个时候就会看到FPGA的管脚被几种颜色划分开了。一种颜色下的IO口代表一组bank。你在吧管脚的location约束完成以后。IO Bank会自动填充完毕的。第三是GroupGroup就是你所输出的信号的名字啦。比如你有一组信号叫cnt。你对cnt的某一根赋值那么。。这里的Group会自动填充为cnt 。第四是Reserved这个是对管脚内部的IO逻辑进行约束的你在下面可以看到一些值。介绍几个吧。bidrectional双向tri-state:三态等等。这个约束的是FPGA在IO端的输入输出区域的逻辑。比如你选择tri-state。那么这个时候在你IO口前部的IO区quartus会自动给你生成一个三态门。第五个是Vref Group这个Group是bank内部的细分区域因为一个bank可能多达60个脚。为了快速定位你可以利用这个vref group来找到某个管脚。这个是非修改属性无法修改。 4、 【问题】我的理解IO standard是根据你所要输入的电平来设置Group是根据所分配的信号端口自动确定而每个引脚的IO Bank本身已经确定 另外分配的引脚所属的IO Bank不同有关系吗引脚的分配除了要考虑专用引脚和用户引脚的区别外还要考虑什么因素 【解答】理解是正确的另外跨越IO bank的信号没有问题。只是注意跨bank的电平是否一致即可。对于跨IO bank的延迟对于FPGA而言没有多少延迟。管脚分配呢你可以看一下quartus里面pin planner内部那张 top view对于每个管脚的说明。大多数管脚是可以当做普通IO使用的。只是有些特殊要求的时候。只可以使用对应的IO比如差分输入高时钟输入等等。这个是要参照对应器件的IO 手册来决定的。而且对应的设计大多数的器件生产商都会给出参考设计。里面包括了IO的设计pcb的设计以及内部程序端口的约束。所以具体问题具体分析。 5、 【问题】什么是锁相环PLL锁相环的工作原理是什么锁相环电路对硬件电路连接有什么要求【解答】锁相环是一种反馈电路其作用是使得电路上的时钟和某一外部时钟的相位同步。PLL通过比较外部信号的相位和由压控晶振VCXO的相位来实现同步的在比较的过程中锁相环电路会不断根据外部信号的相位来调整本地晶振的时钟相位直到两个信号的相位同步。在数据采集系统中锁相环是一种非常有用的同步技术因为通过锁相环可以使得不同的数据采集板卡共享同一个采样时钟。因此所有板卡上各自的本地80MHz和20MHz时基的相位都是同步的从而采样时钟也是同步的。因为每块板卡的采样时钟都是同步的所以都能严格地在同一时刻进行数据采集。通过锁相环同步多块板卡的采样时钟所需要的编程技术会根据您所使用的硬件板卡的不同而不同。对于基于PCI总线的产品M系列数据采集卡PCI数字化仪等所有的同步都是通过RTSI总线上的时钟和触发线来实现的这时其中一块版板卡会作为主卡并且输出其内部时钟通过RTSI线其他从板卡就可以获得这个用于同步的时钟信号对于基于PXI总线的产品则通过将所有板卡的时钟于PXI内置的10MHz背板时钟同步来实现锁相环同步的。关于更多的不同仪器的锁相环技术请点击下面相关的连接。转载于:https://www.cnblogs.com/Jerome_Lee/archive/2009/11/19/1606350.html
